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AD9434有的是款12位單支取樣齒條參數變為器（ADC），重視高的耐腐蝕性、低顯卡功耗和容易用性進行了傳統模式傳統模式優化。該大部分業務在可以達到500 MSPS的變為率，并傳統模式傳統模式優化了在網絡帶寬載波和網絡帶寬傳統模式的比較突出新動態的耐腐蝕性。所有重要性的實用功能，以及取樣始終維持和電阻值系數，都主要包括在集成電路芯片上，以給予刪改的數劇信號變為解決計劃方案。VREF引腳可于網絡監控內規范資料或給予外表規范資料電阻值（外表規范資料傳統模式不得不用SPI串口任用）。ADC還要1.8 V模擬系統電阻值電源開關和一種差分數字5鐘表以構建全的耐腐蝕性控制。數字5輸出與LVDS（ANSI-644）兼容，支持軟件二進制補碼、傾斜二進制格試或格雷碼。數劇數字5鐘表輸出可于精準的輸出數劇指定時間。

特證信噪比=65 dBFS，頻繁多達250 MHz，頻繁為500 MSPSfIN為10.5位ENOB，比較高為250 MHz，500 MSPS（?1.0 dBFS）在500 MSPS（?1.0 dBFS）次數下，SFDR=78 dBc，更高250 MHz模塊化輸人制動器器很好的規則化度DNL=±0.5 LSB典型案例值INL=±0.6 LSB主要表現值500 MSPS時的LVDS（ANSI-644品級）1GHz全耗油率模擬訓練速率片上考生，不需外表解耦低額定功率500 MSPS-LVDS SDR狀態下為690 mW660萬千瓦，500 MSPS-LVDS DDR的模式可c語言編程（標稱）輸人額定電壓規模1.18 V p-p至1.6 V p-p，1.5 V p-p標稱值1.8 V模擬訓練和數字5開關電源運作可選裝轉換統計數據格式文件（偏差二進制，兩個人補碼，格雷碼）掛鐘占空比不穩定性器集成系統統計數據秒表傳輸，中帶可代碼編程秒表和數據信息排列

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